Impact of layout pickups to ESD robustness of MOS transistors in sub 100-nm CMOS process
- Ming Dou Ker*
- , Yong Ru Wen
- , Wen Yi Chen
- , Chun Yu Lin
*此作品的通信作者
研究成果: 書貢獻/報告類型 › 會議論文篇章
11
連結會在新分頁中打開
引文
斯高帕斯(Scopus)