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A 5 GHz fully-integrated low-power phase-locked loop using 0.18-μm CMOS technology
Jeng Han Tsai
*
, Chuan Jung Huang
, Tse Yi Hsieh
, Shao Wei Huang
*
此作品的通信作者
電機工程學系
研究成果
:
雜誌貢獻
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期刊論文
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同行評審
總覽
指紋
指紋
深入研究「A 5 GHz fully-integrated low-power phase-locked loop using 0.18-μm CMOS technology」主題。共同形成了獨特的指紋。
排序方式
重量
按字母排序
INIS
power
100%
ghz range
100%
noise
50%
feedback
25%
chains
25%
speed
25%
voltage
25%
tuning
25%
amplifiers
25%
khz range
25%
transformers
25%
mhz range
25%
buffers
25%
varactors
25%
Engineering
Phase Locked Loop
100%
Phase Noise
66%
Closed Loop
33%
Low Power Consumption
33%
Loop Phase
33%
Varactor
33%
Buffer Amplifier
33%